(熱)數字電路實訓心得體會
我們從一些事情上得到感悟后，可以記錄在心得體會中，它可以幫助我們了解自己的這段時間的學習、工作生活狀態。那么你知道心得體會如何寫嗎？以下是小編為大家整理的數字電路實訓心得體會，希望能夠幫助到大家。
數字電路又可稱為邏輯電路，通過與(&)，或(>=1)，非(o)，異或(=1)，同或(=)等門電路來實現邏輯。
邏輯電路又可分為組合邏輯電路和時序邏輯電路。組合邏輯電路是指在某一時刻的輸出狀態僅僅取決于在該時刻的輸入狀態，而與電路過去的狀態無關。
TTL和CMOS電路：TTL是晶體管輸入晶體管輸出邏輯的縮寫，它用的電源為5V。CMOS電路是由PMOS管和NMOS管(源極一般接地)組合而成，電源電壓范圍較廣，從1.2V-18V都可以。
CMOS的推挽輸出：輸出高電平時N管截止，P管導通;輸出低電平時N管導通，P管截止。輸出電阻小，因此驅動能力強。
CMOS門的漏極開路式：去掉P管，輸出端可以直接接在一起實現線與功能。如果用CMOS管直接接在一起，那么當一個輸出高電平，一個輸出低電平時，P管和N管同時導通，電流很大，可能燒毀管子。單一的管子導通，只是溝道的導通，電流小，如果兩個管子都導通，則形成電流回路，電流大。
輸入輸出高阻：在P1和N1管的漏極再加一個P2管和N2管，當要配置成高阻時，使得P2和N2管都不導通，從而實現高阻狀態。
靜態電流：輸入無狀態反轉(高低電平變換)情況下的電流。
動態電流：電路在邏輯狀態切換過程中產生的功耗，包括瞬間導通功耗和負載電容充放電功耗兩部分。門電路的上升邊沿和下降邊沿是不可避免的，因此在輸入電壓由高到低或由低變高的過程中到達Vt附近時，兩管同時導通產生尖峰電流。該損耗取決于輸入波形的好壞(CMOS工藝)，電源電壓的大小和輸入信號的重復頻率。電路的負載電容的充放電也是很大的一部分。
ESD保護：Electro-Staticdischarge, 靜電放電。
輸入輸出緩沖器：是緩沖器，不是緩存器，就是一個CMOS門電路。輸入緩沖器的作用主要是1，TTL/CMOS電平轉換接口;2，過濾外部輸入信號噪聲。輸出緩沖器的作用是增加驅動能力。
配成輸入模式不一定比輸出模式更省電：輸入模式時輸入緩沖器會打開，而輸出模式時輸出緩沖器會打開。
TESEO上GPIO數據寄存器讀寫的注意點：
配置成普通GPIO時，如果配置成輸出口，那么寫數據寄存器會直接輸出該電平，讀數據寄存器實際就是讀鎖存器中最后一次被寫入的值。如果被配置成輸入口，并且上下拉使能的話，那么寫數據寄存器就是配置上下拉電阻，而讀數據寄存器就是讀輸入引腳的緩沖器，返回的是該引腳的當前電平狀況。有些平臺會有專門的狀態寄存器，無論當前引腳被配置成輸入還是輸出，讀該專門的狀態寄存器都返回該引腳的當前電平狀況。
引腳的BOOT state是指在上電重啟或硬重啟時引腳的狀態，reset release之后的狀態為reset state，reset state和state有可能不一樣。TESEO的UART0_TX為boot1，該引腳的信號在上電重啟或硬重啟時會被鎖存，以備reset release時給default register map用。
IO的電源電壓配置：IO引腳歸屬于不同IOring，不同的IO ring可以被輸入不同的電壓。CPU在判決IO的邏輯電平時會和IO ring的電平(乘以高低電平的系數)作比較。
數字電路中的擺幅：輸入擺幅和輸出擺幅。輸入擺幅指的是最低輸入高電平和最高輸入低電平的差值，輸出擺幅指的是最低輸出高電平和最高輸出低電平之間的差值，TTL的擺幅偏小。
在時序邏輯電路里，如果輸入的時鐘停止，那么整個電路的功耗很低，原因是時序邏輯電路里的很多小單元的輸出是由時鐘驅動的，時鐘停止，基本就是高阻態。如果將整個模塊的電斷了，那么就會更加省電。
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